Exercise
https://texercises.com/exercise/d-flip-flop/
Question
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Exercise:
Ein SR-Latch hat den Nachteil dass der Zustand S R ungültig ist. Ein D-Flip-Flop löst dieses Problem indem es nur einen einzigen Dateneingang D sowie einen Takteingang textttCLK hat. Der Ausgang Q übernimmt den Wert von D genau dann wenn textttCLK ist; andernfalls behält er seinen Zustand. Baue einen D-Flip-Flop aus nur vier textttNAND-Gattern auf. Zeichne den Schaltplan und überprüfe das Verhalten mit einer Wahrheitstabelle!

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Exercise:
Ein SR-Latch hat den Nachteil dass der Zustand S R ungültig ist. Ein D-Flip-Flop löst dieses Problem indem es nur einen einzigen Dateneingang D sowie einen Takteingang textttCLK hat. Der Ausgang Q übernimmt den Wert von D genau dann wenn textttCLK ist; andernfalls behält er seinen Zustand. Baue einen D-Flip-Flop aus nur vier textttNAND-Gattern auf. Zeichne den Schaltplan und überprüfe das Verhalten mit einer Wahrheitstabelle!

Solution:
Contained in these collections:

Attributes & Decorations
Tags
digitalelektronik, informatik
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Difficulty
(3, default)
Points
3 (default)
Language
GER (Deutsch)
Type
Calculative / Quantity
Decoration